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用Verilog HDL进行FPGA设计的一些基本方法
被引:25
作者
:
袁本荣
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0
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0
机构:
北京理工大学计算机科学工程系级硕士班
袁本荣
论文数:
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机构:
刘万春
贾云得
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机构:
北京理工大学计算机科学工程系级硕士班
贾云得
论文数:
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机构:
朱玉文
机构
:
[1]
北京理工大学计算机科学工程系级硕士班
来源
:
微计算机信息
|
2004年
/ 06期
关键词
:
Verilog硬件描述语言;
FPGA设计;
IP核复用;
设计优化;
综合;
D O I
:
暂无
中图分类号
:
TN79 [数字电路];
学科分类号
:
摘要
:
随着FPGA技术和自动设计工具的进步,数字电子系统设计的方法正在发生变化。越来越多的工程师开始使用硬件描述语言和高级综合工具进行设计。VerilogHDL作为一种流行的硬件描述语言,在数字系统设计特别是FPGA设计中有着广泛的应用。本文主要介绍了用VerilogHDL进行FPGA设计和优化的一些实用方法,最后还介绍了IP核复用技术在FPGA设计中的应用。
引用
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页码:93 / 94+14 +14
页数:3
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