基于FPGA内嵌DSP硬核的脉冲压缩设计与实现

被引：5

作者：

苏海 ^{[1
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张群英 ^{[1
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叶盛波 ^{[1
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张晓娟 ^{[1
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方广有 ^{[1
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机构：

[1] 中国科学院电磁辐射与探测技术重点实验室

[2] 中国科学院大学

来源：

电子测量技术 | 2016年 / 39卷 / 09期

关键词：

脉冲压缩; FPGA; 并行计算; 流水线; 时间域;

D O I：

10.19651/j.cnki.emt.2016.09.022

中图分类号：

TN957.51 [雷达信号检测处理];

学科分类号：

摘要：

在伪随机编码体制的超宽带雷达中,原始回波信号的实时脉冲压缩是信号处理的首要和关键步骤。由于超宽带雷达的采样率高、数据量大,而微处理器处理速度和DSP芯片运算能力有限,提出了一种基于FPGA内嵌DSP硬核的快速实时脉冲压缩方法。基于时间域的互相关算法,通过调用FPGA中的DSP硬核进行并行计算,并结合流水线模式,实现快速实时脉冲压缩。仿真与实验结果表明,本文的方法能很好地实现超宽带雷达原始回波信号的快速实时脉冲压缩。

引用

页码：96 / 101

页数：6

共 12 条

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